| 术语 | latching logic |
| 释义 | latching logic 锁存逻辑(电路) A signal modification that causes an output to energize and remain energized (maintained output). Latched output may be immediate or delayed. 一种信号变换电路,使输出为有效状态并保存此状态(维持输出)。锁存的输出可为立即型 或延迟型。 |
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